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链接何庭波最新论文：华为无法获得EUV光刻机，，，，，，，，必须另寻前途
赵成岗
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新闻导读
链接何庭波最新论文：华为无法获得EUV光刻机，，，，，，，，必须另寻前途农业粮食主题接地气，，，，，，，，城市读者也能理解田间和餐桌之间的关系。。。。。。。图示和类比都挺到位，，，，，，，，读完往往能记住主题概想，，，，，，，，而不是只剩“好神奇”。。。。。。。转给想辟谣的家人时也不不安语气太冲或太玄乎。。。。。。。离线下载后没网也能看，，，，，，，，自习室或地铁里不至于中断。。。。。。。伴侣圈少转发谣言后，，，，，，，，自己的信息环境都清净一点。。。。。。。若你也怕“不懂”，，，，，，，，不妨从一条条幼问题起头。。。。。。。
这篇论文既是对今年5月华为颁布的“韬定律”的一连解读，，，，，，，，也是对表界一项固有疑难的正面回应：3D堆叠芯片单元面积晶体管激增，，，，，，，，理当更热、更费电，，，，，，，，华为的芯片是若何平衡机能和功耗的？？？？？
何庭波的主题概想，，，，，，，，在于将芯片能耗的焦点从“推算”转向“移动”。。。。。。。她用一个形象的迸作来注明：人的工作日耗能，，，，，，，，不只来自伏案工作的几幼时，，，，，，，，通勤同样亏损大量能量。。。。。。。
芯片亦然，，，，，，，，晶体管开关实现推算固然耗能，，，，，，，，但数据在？？？？？椤⒌缏分涞某ぞ嗬氪洌，，，，，，，同样吞噬着动态功耗。。。。。。。在典型智能机负载下，，，，，，，，动态功耗占总功耗约九成，，，，，，，，而随着造程微缩，，，，，，，，互连电容带来的传输能耗愈发沉沉。。。。。。。
τ定律与LogicFolding（逻辑折叠）技术的破局点，，，，，，，，在于此。。。。。。。它并非单一将芯片堆叠成多层，，，，，，，，而是沉构电路的空间关系——把正本平面布局中横跨较长的关键连线，，，，，，，，通过折叠设计转化为更短的垂直衔接。。。。。。。
据论文披露，，，，，，，，在部门典型主题中，，，，，，，，连线长度可缩短约20%，，，，，，，，关键蹊径最多缩短70%；；；；；；一个处置？？？？？榈氖敝硬枷咚醵28%，，，，，，，，缓冲器数量从4.36万个降至1.9万个。。。。。。。
何庭波给出麒麟2026的数据：晶体管密度从每平方毫米1.55亿个提升至2.38亿个，，，，，，，，提升55%。。。。。。。在一样机能下，，，，，，，，NPU功耗降落66%，，，，，，，，GPU降落58%，，，，，，，，CPU机能主题降落41%。。。。。。。其中NPU尤为凸起：29TOPS算力不变，，，，，，，，频率降63%，，，，，，，，电压从0.85V降至0.55V，，，，，，，，功耗密度降落73%。。。。。。。
这些数字证明，，，，，，，，折叠并不用然导致发热失控，，，，，，，，若总功耗降落，，，，，，，，整体热负荷反而减轻，，，，，，，，再辅以热感知布局将高热？？？？？榇砦桓橹茫，，，，，，，芯片齐全可能“更冷”。。。。。。。
更大的挑战仍在面前：混合键合间距、晶圆翘曲、对准精度、EDA工具适配等工程难题，，，，，，，，必要将来三到五年持续攻关。。。。。。。散热虽因总功耗降落而缓解，，，，，，，，但基层热量传导问题并未隐没。。。。。。。
何庭波在文末引用了西西弗斯的神话。。。。。。。每一代芯片都是一次推石上山，，，，，，，，折叠赢得功夫余量，，，，，，，，再将其投入功耗或机能，，，，，，，，而后下一代沉启循环。。。。。。。
但与神话分歧的是，，，，，，，，这座山有方向：每个循环留下的，，，，，，，，都是一颗推算更多、耗能更少的芯片。。。。。。。这或许才是τ定律最值得关注的野心：在传统造程缩放逼近极限之时，，，，，，，，它试图为半导体演进启发另一条增长曲线。。。。。。。
而那颗“本该销毁”的τ芯片，，，，，，，，至少已经给出了一个反直觉却扎实的答案，，，，，，，，更立体、更复杂的芯片，，，，，，，，不定更耗电，，，，，，，，反而可能跑得更默默。。。。。。。
热量，，，，，，，，是τ缩放定律——华为折叠硅片所凭据的功夫缩放道理，，，，，，，，以其旨在缩幼的延长τ（“韬”）定名——所面对的最敏感的忧郁。。。。。。。我们对麒麟芯片的实测了局将这一质疑彻底翻转。。。。。。。原因在于每个通勤者都通达的路理：在芯片上，，，，，，，，如同在一个工作日中，，，，，，，，亏损大部门能量的是传输（通勤），，，，，，，，而非工位上的工作（运算）。。。。。。。
问一百位芯片工程师，，，，，，，，将来行业最沉要的技术是什么，，，，，，，，很多人会回覆：3D集成——将芯片层层堆叠，，，，，，，，以增长可专用于系统的硅面积。。。。。。。问任何一位资深芯片工程师，，，，，，，，什么会扼杀3D集成，，，，，，，，你险些总会听到统一个词：热量。。。。。。。
这种推理感触像是天然法令。。。。。。。将有源晶体管堆叠在有源晶体管之上，，，，，，，，在每平方毫米内塞入更多，，，，，，，，将整个器件密封在紧凑的移动设备内，，，，，，，，其了局似乎不成预防。。。。。。。功率转化为热量。。。。。。。热量被困在有限空间内，，，，，，，，导致温度升高。。。。。。。温度一旦超过极限，，，，，，，，就会降低时钟频率，，，，，，，，侵害靠得住性，，，，，，，，并最终“销毁”芯片。。。。。。。依照这种逻辑，，，，，，，，折叠得越密集，，，，，，，，发热就越严害——折叠得越使劲，，，，，，，，“撞墙”的速度就越快。。。。。。。
华为无法坐等这场争论自行平息。。。。。。。由于无法获得竞争敌手持续缩幼晶体管的工具，，，，，，，，华为必须突破这个循环——并且要比任何人都更快。。。。。。。因而，，，，，，，，它终场了缩放空间（即晶体管的线性尺寸），，，，，，，，转而起头缩放功夫：即信号穿越芯片关键蹊径所特有的延长。。。。。。。这个延长被记为τ（发音为tau，，，，，，，，中文译为“韬”），，，，，，，，而τ缩放定律正是旨在推动τ值逐代降低的一场战争[1]。。。。。。。其压缩延长的旗舰技术被称为“逻辑折叠”：将正本铺展在平面上的电路，，，，，，，，折叠成垂直堆叠的层级，，，，，，，，并通过微幼的垂直链路衔接，，，，，，，，使信号传输更短的距离。。。。。。。
从一路头，，，，，，，，τ就被构思为电子系统的定律，，，，，，，，而非单纯的器件技巧：功夫能够在各个层面——器件、电路、芯片和系统——被压缩。。。。。。。逻辑折叠是该框架内的一种技术，，，，，，，，在电路和芯片层面阐扬作用。。。。。。。这种区别很沉要，，，，，，，，由于业界一向在忘却它。。。。。。。
在晶体管诞生后不久，，，，，，，，就出现了一项一致沉要的发现——集成电路。。。。。。。然而，，，，，，，，半导体的进取依然被讲述成一个关于更优良晶体管的故事，，，，，，，，似乎由数十亿晶体管集成而成的电路只是个后来增长的注脚。。。。。。。τ缩放定律也继承了这种盲点：疑惑论者看到τ芯片内部仍是同样的晶体管，，，，，，，，便得出结论，，，，，，，，以为没有任何底子性的变动。。。。。。。但后续的证据将证明他们错了。。。。。。。
当逻辑折叠在2026年5月的IEEE国际电路与系统钻研会上初次公发展示时，，，，，，，，会场内的 skepticism（疑惑）空气浓密。。。。。。。最敏感的否决定见直指热量、热量，，，，，，，，还是热量。。。。。。。
这个逻辑只有一个问题。。。。。。。在真实硅片——定于本月出货的麒麟2026芯片——上的丈量了局显示，，，，，，，，情况刚好相反。。。。。。。该芯片比其前代产品温度更低，，，，，，，，同时每平方毫米的晶体管数量增长了55%，，，，，，，，在一些关键工作上的功耗降低高达66%。。。。。。。下文将诠释其原因，，，，，，，，以及为何逻辑折叠和τ缩放定律将引领华为——很可能还有其它公司——走向将来。。。。。。。
摩尔定律将推算行业（以及很多其他行业）带向了很远的处所，，，，，，，，但它始终依赖一个单一技巧：几何尺寸缩放[2], [3]。。。。。。。让晶体管变得更。。。。。。。，，，，，，，芯片就能同时变得更快、更省电。。。。。。。但十多年前，，，，，，，，这个技巧起头失效。。。。。。。对晶体管结构进行奇妙扭转又争取了十年功夫，，，，，，，，但此刻每个芯片造作商都发现，，，，，，，，每推动一个新节点，，，，，，，，支出更多，，，，，，，，收成却更少[4]-[7]。。。。。。。
对于华为而言，，，，，，，，这种压力来得更早、更剧烈。。。。。。。要超过业界所称的7纳米节点进行微缩，，，，，，，，必要极紫表（EUV）光刻技术，，，，，，，，而华为无法获取该技术。。。。。。。必须另寻前途。。。。。。。
六年的索求疏导我们沉新审视几何尺寸缩放——认清它一向以来的性质：一种伎俩，，，，，，，，而非主张。。。。。。。缩幼晶体管的意思从来不在于“幼”自身，，，，，，，，而在于“幼”所带来的所佑转—更快的开关速度、更短的响应功夫、更高的时钟频率。。。。。。。简而言之，，，，，，，，逻辑折叠是一种在不缩幼空间的情况下“买来”功夫的步骤。。。。。。。在大体一样的硅面积内，，，，，，，，它集成炼多的晶体管，，，，，，，，并让基于这些晶体管构建的系统运行得更快。。。。。。。
实现这一指标的关键工艺称为3D混合键合，，，，，，，，它更靠近于焊接而非封装。。。。。。。将两片晶圆（或一片晶圆与一个芯片）精确对准，，，，，，，，压在一路，，，，，，，，并缓慢加热。。。。。。。在退火过程中，，，，，，，，两片氧化物表表之间形成共价键，，，，，，，，融合成一个单一的介电层，，，，，，，，同时各自表表的铜焊盘相互扩大并融合成陆续的金属。。。。。。。了局是在堆叠的芯片之间形成了一片垂直衔接。。。。。。。在当今一些最先进的商用逻辑芯片中，，，，，，，，这些衔接间距约为10微米，，，，，，，，即每100平方毫米少于100万个垂直衔接。。。。。。。
真正的设计问题是，，，，，，，，在折叠真正起头降低RC（即故障和亏损每个信号的电阻和电容）之前，，，，，，，，单元面积内应有几多垂直衔接。。。。。。。固然没有封关大局的答案，，，，，，，，但有一个直观的判断是靠得住的。。。。。。。典型的逻辑工艺顶层金属间距为720纳米。。。。。。。若是将键合间距与之匹配，，，，，，，，面对面的晶圆就能够直接衔接顶层金属信号。。。。。。。若是选择更稀少的间距，，，，，，，，这些信号就必须扇出到更稀少的焊盘——这会增长布线、拥塞和RC成本，，，，，，，，而这刚好是折叠旨在解除的成本。。。。。。。设计空间的索求证实了这一向觉：1.5微米的间距已能支持优良的逻辑折叠，，，，，，，，1微米更好，，，，，，，，而720纳米将进一步扩大收益。。。。。。。将来，，，，，，，，我们进展将键合间距进一步缩幼至480纳米，，，，，，，，使混合键合焊盘可能衔接到较低的金属层，，，，，，，，为逻辑折叠提供更大的设计自由度。。。。。。。
我们将混合键合视为晶圆级、跨层器件步骤，，，，，，，，而非封装步骤。。。。。。。芯片到晶圆键合是一种芯片处置过程——拾取和搁置——从芯片封装工厂演变而来。。。。。。。其精度基线较低，，，，，，，，即便经过多年改进，，，，，，，，仍停顿在微米级别。。。。。。。晶圆到晶圆键合则始于一个分歧的世界：晶圆厂处置，，，，，，，，其中光刻工具已能将套刻精度节造在几纳米内。。。。。。。这个高精度基线是正确的起点，，，，，，，，但键合仍需解决光刻扫描仪从未面对的问题——应力节造、CMP平展化、清洁、晶圆翘曲、边缘斜率和对准——而后能力实现亚微米间距。。。。。。。在40纳米工艺节点上，，，，，，，，我们在麒麟2026中实现了1.5微米的混合键合间距——5000万个垂直互连，，，，，，，，其中10%到15%用于传输信号。。。。。。。麒麟2027的硅片已经达到1微米间距和超过1亿个垂直互连。。。。。。。预计在三年内，，，，，，，，我们将匹配720纳米的顶层金属间距，，，，，，，，实现一比一的传动比，，，，，，，，并占有超过2亿个垂直互连。。。。。。。
有了垂直衔接，，，，，，，，折叠就能够起头了。。。。。。；；；；；；墓こ淌Σ槌索梓隨oC中工作最繁沉的？？？？？椤狽PU、CPU、GPU和DSP——并找出每个？？？？？槟诓孔畛ぁ⒆盥⒆詈牡绲乃锦杈。。。。。。。而后沉新设计每个？？？？？椋，，，，，，，使其同使丶据两层硅片，，，，，，，，将这些长距离的水平衔接转变为从一个芯片到另一个芯片的短距离垂直跳跃。。。。。。。
在首款依赖逻辑折叠的移动系统级芯片（SoC）麒麟2026上，，，，，，，，晶体管密度在一代之间从约莫每平方毫米1.55亿个跃升至2.38亿个——提升了55%。。。。。。。这相当于我们从前三年通过几何微缩所获得的增长。。。。。。。
与平面工艺的前代产品相比，，，，，，，，在一样机能下，，，，，，，，麒麟2026在现实基准测试中，，，，，，，，NPU功耗降低了66%，，，，，，，，GPU降低了58%，，，，，，，，机能主题CPU降低了41%。。。。。。。我们在每平方毫米内放入了更多的晶体管，，，，，，，，而芯片在单元工作量下的运行温度却更低，，，，，，，，而不是更高。。。。。。。
这一了局必要诠释，，，，，，，，由于它看起来像是违反了疑惑论者所引用的物理学道理。。。。。。。但事实并非如此。。。。。。。这揭示了一个关于芯片功耗真正去向的教训——答案并不在大无数人想当然的处所。。。。。。。
在智能手机典型的日常使用中，，，，，，，，其芯片以两种方式亏损功率。。。。。。。其一，，，，，，，，静态漏电，，，，，，，，即即便不进行推算也会损耗的功率，，，，，，，，其占比极幼。。。。。。。与之相对的动态功耗，，，，，，，，即推算过程中损耗的功率，，，，，，，，约莫占总功耗的90%。。。。。。。
数字电路根基上通过两种方式亏损动态能量。。。。。。。第一种是开关：翻转晶体管栅极，，，，，，，，对逻辑门的微幼电容进行充放电，，，，，，，，以将位从0变为1，，，，，，，，再变回来。。。。。。。这是“真正的工作”——推算自身。。。。。。。
第二种是传输信号：对承载这些比特在芯片各部门间传输的长金属导线进行充放电。。。。。。。导线是散布在距离上的电容。。。。。。。信号传输得越远，，，，，，，，必要充电的电容就越多，，，，，，，，能量随该电容值成比例增长。。。。。。。在动态功耗的教科书公式中：
以下正是让直觉犯错的处所：在现代SoC？？？？？橹校，，，，，，，导线——即传输——通常亏损的能量比栅极——即推算——更多。。。。。。。处置器亏损的大部门功率并非用于“思虑”，，，，，，，，而是用于“通勤”。。。。。。。
试想一个通常办公室人员的逐日能量预算。。。。。。。人们容易想当然地以为大部门能量亏损在真正的工作上——会议、电子表格、思虑。。。。。。。但事实并非如此。。。。。。。对很多办公室人员来说，，，，，，，，一天中最大的能量亏损是通勤：每天两次往返于家和办公室之间的开车或坐火车。。。。。。。在办公室的工作相比之下亏损较少；；；；；；交通才是大头。。。。。。。
芯片并无分歧。。。。。。。栅极掌管“思虑”，，，，，，，，导线掌管“通勤”。。。。。。。在大型AI集群中同样如此：超过80%的能量用于移动数据，，，，，，，，而非对其进行推算。。。。。。。同样的不平衡，，，，，，，，以较和善的大局，，，，，，，，存在于每个智能手机SoC内部。。。。。。。
一旦你从这个角度对待功耗，，，，，，，，半数叠的热学质疑就被颠覆了。。。。。。。品评者如果将晶体管更缜密地封装在一路必然提高功耗密度，，，，，，，，由于他们潜意识里关注的是推算栅极的数量——即“案头工作”。。。。。。。但主导成分是“通勤”。。。。。。。而逻辑折叠做了什么？？？？？它把每幼我的家都搬到了离办公室更近的处所。。。。。。。
当你将电路折叠成由亚微米间距混合键合焊盘衔接的垂直层级时，，，，，，，，已经必要横跨长距离水平导线（数百微米）的信号，，，，，，，，此刻只需通过几微米表的键合焊盘垂直向下传输。。。。。。。凭据尊龙凯时经验，，，，，，，，折叠蹊径上的导线长度在典型主题上缩短了20%，，，，，，，，在一些关键蹊径上缩短了高达70%。。。。。。。时钟网络——一些最忙乱、最耗电的导线——缩短水平如此之大，，，，，，，，以至于我们将时钟缓冲器数量削减了一半以上。。。。。。。仅在一个处置？？？？？樯希，，，，，，，折叠就将时钟布线缩短了28%，，，，，，，，缓冲器数量从43,600个降至19,000个。。。。。。。
每缩短一根导线，，，，，，，，就意味着必要充电的电容减。。。。。。。，，，，，，，因而功率方程中的主导项随之降落。。。。。。。“案头工作”——即现实的开关操作——根基未变，，，，，，，，但“通勤”被大幅削减。。。。。。。这就是功耗密度降低的起源。。。。。。。并非由于推算更少，，，，，，，，而是由于数据传输更少。。。。。。。
主导智能手机SoC热预算的？？？？？椋，，，，，，，正是那些传输数据最多的？？？？？椋涸诵蠥I推理的NPU、进行像素着色的GPU，，，，，，，，以及处置信号的DSP。。。。。。。它们发热严沉的原因一样：它们是通鸭集型的。。。。。。。由于它们在内存、缓冲区和算术单元之间来回穿梭海量数据，，，，，，，，其功耗的很大一部门来自“通勤”而非“推算”——而这正是折叠所能攻克的部门。。。。。。。
为了展示每个？？？？？榇勇呒鄣中获益几多，，，，，，，，我们让折叠芯片与其平面工艺的前代产品麒麟9030 Pro在一样机能下（一样的AI吞吐量、帧率或基准分数）进行对比测试。。。。。。。一个必要较低速度就能实现一样工作的？？？？？椋，，，，，，，能够在更低电压下运行，，，，，，，，从而带来叠加的节能成效。。。。。。。同时，，，，，，，，由于同样的硅片也能够全速运行，，，，，，，，每个？？？？？榈牧街帜Ｊ健肭叭纹ヅ涞幕埽，，，，，，，以及全速模式——了局均已汇报。。。。。。。以下是硅片对这些？？？？？榈幕惚。。。。。。。
如图1所示，，，，，，，，每个图表蕴含五个子图——机能、频率、电压、归一化功耗和归一化功耗密度——以及三个柱状条：平面工艺的麒麟9030 Pro、同机能下的麒麟2026，，，，，，，，以及涡轮模式下的麒麟2026。。。。。。。归一化子图中的虚线暗示9030 Pro的基线。。。。。。。折叠后的占地面积是两层堆叠的投影面积——功耗密度正是以此为尺度进行丈量的。。。。。。。
在品评者最不安堆叠的？？？？？橹校，，，，，，，NPU 因其密度最高且温度也最高而首当其冲。。。。。。。然而，，，，，，，，它却实现了最大的降幅：在一样的 29 TOPS 下，，，，，，，，其时钟频率能够降低 63%，，，，，，，，电压能够从 0.85V 降至 0.55V。。。。。。。这导致功耗降低了 66%，，，，，，，，功耗密度更是惊人地降落了 73%。。。。。。。GPU 紧随其后：在与 Kirin9030 Pro 一样的 61 FPS 下运行，，，，，，，，但电压降低了 200mV，，，，，，，，功耗降落了 58%。。。。。。。这种差距齐全沿着“通勤”的脉络散布：一个？？？？？樵讲⑿幼⒃奖匾罅渴荩，，，，，，，折叠带来的回报就越大。。。。。。。
DSP 是一个例表，，，，，，，，它提供了一个沉要的教训：使用逻辑折叠，，，，，，，，面积缩幼的速度可能快于功耗（图 2）。。。。。。。第一代折叠（麒麟 2026）以降低 25% 的功耗实现一样工作，，，，，，，，但功耗密度——即每平方毫米亏损的功率——却上升了 24%，，，，，，，，而真正对节造热量起关键作用的正是功耗密度。。。。。。。这种增长的原因很单一：折叠将 DSP 的占地面积缩幼了 40%，，，，，，，，因而即便其功耗降落，，，，，，，，功耗密度依然攀升。。。。。。。第二代折叠（麒麟 2027）解决了这个问题：我们已经获得了该硅片，，，，，，，，并测得其功耗密度低于平面工艺原版，，，，，，，，同时功耗降低了 47%。。。。。。；；；；；；谎灾，，，，，，，密度是一个设计输出，，，，，，，，而非宿命。。。。。。。
CPU 机能主题从折叠中获益匪浅——在 HNX 基准测试中，，，，，，，，以低 9% 的时钟频率和低 200mV 的供电电压匹配了其前代产品的分数，，，，，，，，功耗降低了 41%。。。。。。。但其功耗密度的节俭在这些热？？？？？橹惺亲畈黄鹧鄣。。。。。。。这并非折叠的失败；；；；；；它暗示了一些沉要信息，，，，，，，，我们稍后会会商。。。。。。。
当然，，，，，，，，我们不仅关注功耗节俭。。。。。。。我们同样让麒麟 2026 的？？？？？槿僭诵校，，，，，，，以观察它们与 9030 Pro 相比能有何种阐发。。。。。。。在全力运行时，，，，，，，，折叠后的 NPU 可提供 70 TOPS——比其前代产品逾越 141%，，，，，，，，GPU 的帧率提升 42%，，，，，，，，CPU 在 HNX 基准测试中的得分提升 18%；；；；；；在这些模式下，，，，，，，，它们的功耗密度都高于平面工艺的前代芯片。。。。。。。因而，，，，，，，，折叠为系统提供了一个平面芯片从未占有的节造旋钮：凭据场景分歧，，，，，，，，统一个？？？？？榧饶芄怀晌翱犊怼保，，，，，，，也能够成为“纪录突破者”。。。。。。。
缩短“通勤”诠氏缢部门功耗节。。。。。。。，，，，，，，但更多的节俭来自于降低电压，，，，，，，，由于动态功耗与电压的平方成正比。。。。。。。逻辑折叠通过将电路分为三类来解锁这种降低：真正的串行电路，，，，，，，，必要峰值频率和电压；；；；；；可并行化的电路，，，，，，，，将工作分散到很多并走运行的副本上；；；；；；以及介于两者之间、部门串行部门并行的电路[8]。。。。。。。
绝不当协的串行电路是少数。。。。。。。绝大无数情况下，，，，，，，，现代 SoC 的晶体管服务于第二和第三类电路，，，，，，，，即 NPU、GPU 和 DSP，，，，，，，，它们之所以亏损大量功率，，，，，，，，刚好是由于它们宽、并行且数据饥渴。。。。。。。CPU 机能主题（大核）是第一类电路中最清澈的代表，，，，，，，，由于其单个急剧的整数执行线程无法并行化，，，，，，，，且必须靠近电压和频率曲线的顶端运行。。。。。。；；；；；；毓艘幌拢，，，，，，，折叠在 HNX 基准测试的同机能下仅为其带来了适度的 9% 时钟频率降低——这是线性的“通勤”节。。。。。。。，，，，，，，而非二次方的电压节俭。。。。。。。将逻辑折叠利用于低并行度的 CPU 机能主题，，，，，，，，必要精心的设计、先进的 EDA 工具链和漫长的验证周期。。。。。。。这是一次系统性的改革，，，，，，，，而非权宜之计。。。。。。。只管麒麟 2026 已获得显著成就，，，，，，，，但大部门工作仍在前方，，，，，，，，必要在将来三到五年内进行积极、索求性的创新。。。。。。。然而，，，，，，，，在通往这些最终成就的路路上，，，，，，，，每年都将实现切实且累积的改进。。。。。。。
幸运的是，，，，，，，，这些架构上的阻碍无需仅由硅片来克服。。。。。。。智能手机占有一个粗略分析所忽略的优势：深度的硬件-软件协同设计。。。。。。。工作调度器和折叠后的疆域并非试图让一个英雄般的大核单独承担所有繁沉的工作负载，，，，，，，，而是协同优化，，，，，，，，在软件中并行化工作，，，，，，，，并将其分配到几个幼型、高效的核上。。。。。。。这使得大核必须承担的串行工作部门，，，，，，，，维持在利用允许的最幼领域内。。。。。。。这将工作负载从第一类转移到第二类，，，，，，，，即二次方电压杠杆生效的处所。。。。。。。
在这里，，，，，，，，两个杠杆结合起来。。。。。。。折叠缩短了导线，，，，，，，，同时在统一占地面积内为更多晶体管腾出空间。。。。。。。这些额表的晶体管能够用来创建很多电路副本，，，，，，，，这些副本能够并走运行，，，，，，，，将工作分散开来，，，，，，，，从而使每个副本都能以更低的时钟频率和电压运行。。。。。。。“通勤”论点带来了 C 的线性节。。。。。。。，，，，，，，而并行性论点则带来了 V? 的二次方节俭。。。。。。。
折叠后的 NPU 就是一个典型例子。。。。。。。其前代产品蕴含一个大核和两个能效核，，，，，，，，而折叠带来的晶体管剩余则用于支付四个大核。。。。。。。更宽泛的阵列在 0.7V 电压下提供 70 TOPS——远低于其前代产品在提供不到一半机能时所需的 0.85V。。。。。。。更多硬件，，，，，，，，更和善地运行，，，，，，，，却实现更多工作：二次方杠杆，，，，，，，，齐全依照公式的预测工作。。。。。。。
这就是为什么一个密度更高的芯片却亏损更少功率的原因。。。。。。。必要高电压的串行工作占比很。。。。。。。，，，，，，，不及以主导功耗预算；；；；；；其他所有部门——绝大无数的并行部门——被折叠得更宽，，，，，，，，时钟设置得更和善，，，，，，，，并在更低电压下运行。。。。。。。
这种设计镜像了吉恩·阿姆达尔驰名的洞见：法式的串行部门限度了并凶咴所能带来的收益。。。。。。。阿姆达尔定律是关于软件的。。。。。。。而逻辑折叠揭示的是其硬件孪生兄弟：硅片的串行部门很。。。。。。。，，，，，，，因而芯片的大部门能够用速度换取并行性。。。。。。。它们如同双星——一个摆布着代码中的算法，，，，，，，，另一个摆布着电路中的延长与能量，，，，，，，，组成了系统-技术协同优化（STCO）的理论基石。。。。。。。
只管我们通过逻辑折叠实现了诸多功耗节。。。。。。。，，，，，，，但人们仍可能辩论说我们会有热问题。。。。。。。堆叠两层忙乱开关的晶体管会集中热量，，，，，，，，由于底层产生的热量必须穿过顶层资料能力散发。。。。。。。
我们以为品评者对准了谬误的指标。。。。。。。关键不在于热量自身，，，，，，，，而在于热密度，，，，，，，，再深刻一层，，，，，，，，在于晶体管的结温——这才是真正决定速度、漏电和靠得住性的指标。。。。。。。芯片失效并非由于耗散了特定数量的瓦特，，，，，，，，而是由于某个晶体管结温超过了其工作温度极限。。。。。。。所有值得会商的热学论点，，，，，，，，最终都是关于这个结温的。。。。。。。
有两件事能够将其节造在可控领域内。。。。。。。首先，，，，，，，，折叠降低了热源处的热密度：在一样机能下，，，，，，，，总功率的确降落了，，，，，，，，并且削减的功率散布在了多个有源硅层上，，，，，，，，而非一个密集的平面。。。。。。。这实现了更低的瓦特/立方毫米，，，，，，，，而热密度正是决定结温凹凸的关键。。。。。。。
其次，，，，，，，，渣滓的热量得到了治理。。。。。。。由于折叠缩幼了 NPU 和其他热？？？？？榈恼嫉孛婊，，，，，，，就有了空间让热量在垂直向上传输到表表前，，，，，，，，先水平扩散开来，，，，，，，，从而解除部门热点并降低结温。。。。。。。适度的垂直温度梯度（底层比顶层高几度）被作为设计参数加以预算，，，，，，，，步骤是将最热的？？？？？楦橹迷谌攘孔钊菀咨⒎⒌牡匚。。。。。。。真正的敌人不是均匀温度，，，，，，，，而是部门热点，，，，，，，，即结温远高于其邻居的地位。。。。。。。当设计工具自动在层级间交错分列热逻辑和冷逻辑，，，，，，，，预防热点直接相互堆叠时，，，，，，，，折叠就赢得了其热学裕量。。。。。。。
这就是为什么尊龙凯时麒麟 2026 实现规划刻意守旧：折叠选择性地利用于获益最大的关键蹊径，，，，，，，，并选取热感知布局，，，，，，，，而非盲目堆叠所有器材。。。。。。。依照这种方式——降低热密度、水平扩散、预算垂直梯度并解除热点——结温便能维持在其窗口之内。。。。。。。
τ 是一个功夫缩放定律，，，，，，，，而非能量定律。。。。。。。一个运行得更快但亏损更多功率的折叠系统并不违反任何功夫缩放道理——但它会在午饭前耗尽你的电池。。。。。。。麒麟芯片运行温度更低，，，，，，，，是由于我们有意识地将折叠所赢得的功夫裕量用于降低电压和功耗。。。。。。。这种衡量是一门配套学科，，，，，，，，而非定律的免费奉送。。。。。。。
能以三分之一的功耗实现其前代工作的折叠 NPU，，，，，，，，同样能够超过其前代 141%，，，，，，，，从而超过其功耗密度。。。。。。。物理学允许这两种设置；；；；；；是工程纪律选择了温度更低的那一种。。。。。。。这是我们打算在每一代新芯片中都做出的选择。。。。。。。
折叠后的 CPU 刻意守旧，，，，，，，，仅针对关键蹊径。。。。。。。然而，，，，，，，，它已能在今年将机能主题频率复原到 3.1GHz。。。。。。。要在将来三到五年内开释逻辑折叠的全数潜力，，，，，，，，必要全行业领域的积极创新——扩大设计空间、缩幼混合键合间距、集成较低金属层的 TSV、垂直堆叠更多层级等等。。。。。。。逻辑折叠将为麒麟 CPU 主题频率达到 5GHz 及以上摊平路路。。。。。。。这一路线图是可行且经济上可行的。。。。。。。
在神话中，，，，，，，，西西弗斯被罚将巨石推上山坡，，，，，，，，却只能看着它滚下，，，，，，，，而后沉新起头。。。。。。。τ 缩放定律下的工程学也共享这种节拍：折叠芯片，，，，，，，，赢得功夫裕量，，，，，，，，将其用于降低功耗——而后下一代到来，，，，，，，，巨石沉新起头滚动。。。。。。。上述提出的折叠布线并非逃离那个循环；；；；；；它是下一次推动。。。。。。。尊龙凯时故事与神话分路扬镳之处在于，，，，，，，，这个山坡通向某个处所：每个循环城市留下一款推算更多、亏损更少的芯片，，，，，，，，而累积的距离正是业界所称的进取。。。。。。。工作永无终点——这不是定律的弱点，，，，，，，，而是工作说明书。。。。。。。并且，，，，，，，，你必须设想这些工程师是欢乐的。。。。。。。
但热量——这个每幼我首先想到的否决理由——了局却成立在对芯片能量亏损方式的误会之上。。。。。。。忧郁只推算了“案头工作”。。。。。。。物理学却由“通勤”主导。。。。。。。逻辑折叠缩短了“通勤”，，，，，，，，同时降低了功夫常数 τ 和能量，，，，，，，，由于距离会同时亏损两者。。。。。。。
我们能预感的 τ 的每一种将来，，，，，，，，其成败都取决于功耗。。。。。。。功夫裕量是工具；；；；；；能量是奖品。。。。。。。这个定律的下一个十年，，，，，，，，其评价尺度将不是折叠仓库能跑多快，，，，，，，，而是它们在运行时点火得有多幼。。。。。。。
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